NB3V8312C

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?1-TO-12 LVCMOS/LVTTL

制造商：ON

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產(chǎn)品信息

The NB3V8312C is a high performance, low skew LVCMOS fanout buffer which can distribute 12 ultra-low jitter clocks from an LVCMOS/LVTTL input up to 250 MHz. The 12 LVCMOS output pins drive 50Ωseries or parallel terminated transmission lines. The outputs can also be disabled to a high impedance (tri-stated) via the OE input, or enabled when High. The NB3V8312C provides an enable input, CLK_EN pin, which synchronously enables or disables the clock outputs while in the LOW state. Since this input is internally synchronized to the input clock, changing only when the input is LOW, potential output glitching or runt pulse generation is eliminated. Separate VDD core and VDDO output supplies allow the output buffers to operate at the same supply as the VDD (VDD = VDDO) or from a lower supply voltage. Compared to single-supply operation, dual supply operation enables lower power consumption and output-level compatibility. The VDD core supply voltage can be set to 3.3 V, 2.5 V or 1.8 V, while the VDDO output supply voltage can be set to 3.3 V, 2.5 V, or 1.8 V, with the constraint that VDD >/= VDDO.

VDD core supply voltage can be set to 3.3 V, 2.5 V or 1.8 V
VDDO output supply voltage can be set to 3.3 V, 2.5 V, or 1.8 V, with the constraint that VDD >/= VDDO
250 MHz Maximum Clock Frequency
Accepts LVCMOS, LVTTL Clock Inputs
12 LVCMOS Clock Outputs
150 ps Max. Skew Between Outputs
Temp. Range 40C to +85C
32pin LQFP and QFN Packages
Synchronous Clock Enable

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型號(hào)	制造商	描述	購(gòu)買
NB3V8312CFAG	ON	NB3V8312C 是一款高性能、低歪曲率 LVCMOS 扇出緩沖器，可基于最高 250 MHz 的 LVCMOS/LVTTL 輸入分發(fā) 12 個(gè)超低抖動(dòng)時(shí)鐘。12 個(gè) LVCMOS 輸出引腳驅(qū)動(dòng) 50Ω 串聯(lián)或并聯(lián)端接傳輸線路。這些輸出還可通過(guò) OE 輸入禁用為高阻抗（三態(tài)），或在高電平時(shí)啟用。NB3V8312C 提供啟用輸入、CLK_EN 引腳，同時(shí)啟用時(shí)鐘輸出，或在低電平狀態(tài)時(shí)對(duì)其禁用。因?yàn)榇溯斎肱c輸入時(shí)鐘進(jìn)行內(nèi)部同步，僅在輸入為低電平時(shí)進(jìn)行變化，所以不會(huì)出現(xiàn)輸出故障或矮脈沖生成。單獨(dú)的 VDD 內(nèi)核和 VDDO 輸出電源允許輸出緩沖器以與 VDD (VDD = VDDO) 的電源或更低電源電壓允許。與單電源運(yùn)行相比，雙電源運(yùn)行可實(shí)現(xiàn)更低功耗和輸出電平兼容性。VDD 內(nèi)核電源電壓可設(shè)置為 3.3 V、2.5 V 或 1.8 V，VDDO 輸出電源電壓可設(shè)置為 3.3 V、2.5 V 或 1.8 V，但有個(gè)約束是 VDD >/= VDDO。	立即購(gòu)買
NB3V8312CMNR4G	ON	NB3V8312C 是一款高性能、低歪曲率 LVCMOS 扇出緩沖器，可基于最高 250 MHz 的 LVCMOS/LVTTL 輸入分發(fā) 12 個(gè)超低抖動(dòng)時(shí)鐘。12 個(gè) LVCMOS 輸出引腳驅(qū)動(dòng) 50Ω 串聯(lián)或并聯(lián)端接傳輸線路。這些輸出還可通過(guò) OE 輸入禁用為高阻抗（三態(tài)），或在高電平時(shí)啟用。NB3V8312C 提供啟用輸入、CLK_EN 引腳，同時(shí)啟用時(shí)鐘輸出，或在低電平狀態(tài)時(shí)對(duì)其禁用。因?yàn)榇溯斎肱c輸入時(shí)鐘進(jìn)行內(nèi)部同步，僅在輸入為低電平時(shí)進(jìn)行變化，所以不會(huì)出現(xiàn)輸出故障或矮脈沖生成。單獨(dú)的 VDD 內(nèi)核和 VDDO 輸出電源允許輸出緩沖器以與 VDD (VDD = VDDO) 的電源或更低電源電壓允許。與單電源運(yùn)行相比，雙電源運(yùn)行可實(shí)現(xiàn)更低功耗和輸出電平兼容性。VDD 內(nèi)核電源電壓可設(shè)置為 3.3 V、2.5 V 或 1.8 V，VDDO 輸出電源電壓可設(shè)置為 3.3 V、2.5 V 或 1.8 V，但有個(gè)約束是 VDD >/= VDDO。	立即購(gòu)買
NB3V8312CFAR2G	ON	NB3V8312C 是一款高性能、低歪曲率 LVCMOS 扇出緩沖器，可基于最高 250 MHz 的 LVCMOS/LVTTL 輸入分發(fā) 12 個(gè)超低抖動(dòng)時(shí)鐘。12 個(gè) LVCMOS 輸出引腳驅(qū)動(dòng) 50Ω 串聯(lián)或并聯(lián)端接傳輸線路。這些輸出還可通過(guò) OE 輸入禁用為高阻抗（三態(tài)），或在高電平時(shí)啟用。NB3V8312C 提供啟用輸入、CLK_EN 引腳，同時(shí)啟用時(shí)鐘輸出，或在低電平狀態(tài)時(shí)對(duì)其禁用。因?yàn)榇溯斎肱c輸入時(shí)鐘進(jìn)行內(nèi)部同步，僅在輸入為低電平時(shí)進(jìn)行變化，所以不會(huì)出現(xiàn)輸出故障或矮脈沖生成。單獨(dú)的 VDD 內(nèi)核和 VDDO 輸出電源允許輸出緩沖器以與 VDD (VDD = VDDO) 的電源或更低電源電壓允許。與單電源運(yùn)行相比，雙電源運(yùn)行可實(shí)現(xiàn)更低功耗和輸出電平兼容性。VDD 內(nèi)核電源電壓可設(shè)置為 3.3 V、2.5 V 或 1.8 V，VDDO 輸出電源電壓可設(shè)置為 3.3 V、2.5 V 或 1.8 V，但有個(gè)約束是 VDD >/= VDDO。	立即購(gòu)買
NB3V8312CMNG	ON	NB3V8312C 是一款高性能、低歪曲率 LVCMOS 扇出緩沖器，可基于最高 250 MHz 的 LVCMOS/LVTTL 輸入分發(fā) 12 個(gè)超低抖動(dòng)時(shí)鐘。12 個(gè) LVCMOS 輸出引腳驅(qū)動(dòng) 50Ω 串聯(lián)或并聯(lián)端接傳輸線路。這些輸出還可通過(guò) OE 輸入禁用為高阻抗（三態(tài)），或在高電平時(shí)啟用。NB3V8312C 提供啟用輸入、CLK_EN 引腳，同時(shí)啟用時(shí)鐘輸出，或在低電平狀態(tài)時(shí)對(duì)其禁用。因?yàn)榇溯斎肱c輸入時(shí)鐘進(jìn)行內(nèi)部同步，僅在輸入為低電平時(shí)進(jìn)行變化，所以不會(huì)出現(xiàn)輸出故障或矮脈沖生成。單獨(dú)的 VDD 內(nèi)核和 VDDO 輸出電源允許輸出緩沖器以與 VDD (VDD = VDDO) 的電源或更低電源電壓允許。與單電源運(yùn)行相比，雙電源運(yùn)行可實(shí)現(xiàn)更低功耗和輸出電平兼容性。VDD 內(nèi)核電源電壓可設(shè)置為 3.3 V、2.5 V 或 1.8 V，VDDO 輸出電源電壓可設(shè)置為 3.3 V、2.5 V 或 1.8 V，但有個(gè)約束是 VDD >/= VDDO。	立即購(gòu)買

技術(shù)資料

標(biāo)題	類型	大?。↘B）	下載
Storage and Handling of Drypack Surface Mount Device	PDF	49	點(diǎn)擊下載
Clock Generation and Clock and Data Marking and Ordering Information Guide	PDF	71	點(diǎn)擊下載
Board Mounting Notes for Quad Flat-Pack No-Lead Package (QFN)	PDF	40	點(diǎn)擊下載
Ultra-Low Jitter, Low Skew 1:12 LVCMOS/LVTTL Fanout Buffer	PDF	153	點(diǎn)擊下載
Phase Noise and Additive Phase Jitter Analysis Using the NB3V8312C	PDF	542	點(diǎn)擊下載
QFN32, 5x5, 0.5P, 3.1x3.1EP	PDF	56	點(diǎn)擊下載
NB3V8312C IBIS Model	UNKNOW	85	點(diǎn)擊下載

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2012-06-07

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NL3S325	NCV33164	NCS3402	NLSX5012

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