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Quartus? Prime 設(shè)計(jì)軟件 v18.0
Intel? Quartus Prime 設(shè)計(jì)軟件 v18.0 （Quartus? Prime Design Software v18.0）大大減少了編譯時(shí)間并降低虛擬存儲(chǔ)器需求
發(fā)布時(shí)間：2018-09-13
Intel Quartus Prime 軟件 v18.0 在三個(gè)主要領(lǐng)域進(jìn)行了改進(jìn)，從而解決設(shè)計(jì)人員最為關(guān)心的問題——性能、生產(chǎn)效率和可用性。Intel Quartus Prime 專業(yè)版軟件 v18.0 支持 Intel Stratix? 10 TX、MX、SX 和 GX 器件。相比以前發(fā)布的版本，v18.0 具有更快的 Intel Stratix 10 設(shè)計(jì)編譯時(shí)間，從而加速了 FPGA 開發(fā)。Intel Stratix 10 設(shè)計(jì)的規(guī)模越大，就越能節(jié)省更多的編譯時(shí)間。有關(guān)如何減少編譯時(shí)間的額外設(shè)置的說明，可參見編譯器用戶指南。借助 Intel Quartus 基本專業(yè)版軟件 v18.0，設(shè)計(jì)對(duì)峰值虛擬存儲(chǔ)器的要求將比 17.1.1 版大為減少。所有 Intel Stratix 10 設(shè)計(jì)都可以在不到 64 GB 的存儲(chǔ)空間中編譯。
支持并發(fā)分析，能夠在編譯運(yùn)行時(shí)分析設(shè)計(jì)的結(jié)果。定時(shí)分析儀、網(wǎng)表查看器和匯編報(bào)告均支持這一特性，從而讓設(shè)計(jì)更快地完成。部分重配置 (PR) 允許用戶隨時(shí)重新動(dòng)態(tài)配置 FPGA，而其余的 FPGA 設(shè)計(jì)將繼續(xù)正常工作。借助 Intel Quartus Prime 專業(yè)版軟件 v18.0，用戶可以在由 Nimbix 提供的高性能計(jì)算環(huán)境中使用云端 Intel FPGA 編程工具加快程序的開發(fā)。詳情請(qǐng)查詢?cè)品?wù)網(wǎng)頁。
Quartus? Prime 設(shè)計(jì)軟件 v18.0特性
更快的編譯時(shí)間
降低了峰值虛擬存儲(chǔ)器
并發(fā)分析
PR 允許用戶對(duì) FPGA 的一個(gè)部分進(jìn)行動(dòng)態(tài)配置
云端軟件工具
允許相干信號(hào)從 Intel Stratix 10 器件的硬處理器系統(tǒng) (HPS) 接口通過 ACE lite 支持傳遞至知識(shí)產(chǎn)權(quán) (IP)
集成了使用 SystemVerilog 接口的 IOP 元件，可連接 Platform Designer 的系統(tǒng)
顯著減少 IP 升級(jí)再生時(shí)間
Quartus? Prime 設(shè)計(jì)軟件 v18.0應(yīng)用
通過引用其子系統(tǒng)和 IP 元件的仿真信息，平臺(tái)設(shè)計(jì)人員能夠產(chǎn)生層級(jí)結(jié)構(gòu)仿真腳本，而無需穿越系統(tǒng)層級(jí)結(jié)構(gòu)
高分辨率的顯示器支持提供了最新的 GUI，以支持新的平臺(tái)和用于高分辨率的顯示器的可擴(kuò)展圖標(biāo)
在改進(jìn)的工具集成中，接口計(jì)劃程序可以在不關(guān)閉英特爾 Quartus 軟件 GUI 的情況下啟動(dòng)
請(qǐng)參閱 Intel Quartus Prime 軟件支持頁面了解更多應(yīng)用信息
在 Platform Designer 中使用 Verilog 語法來連接端口，提供線級(jí)連接
| 圖片 | 數(shù)據(jù)手冊(cè) | 產(chǎn)品型號(hào) | 產(chǎn)品分類 | 產(chǎn)品描述 | 價(jià)格 | 操作 |
|---|---|---|---|---|---|---|
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