
ECP5? SERDES 使能型 FPGA 系列

Lattice Semiconductor 的 ECP5 FPGA 系列(ECP5? SERDES Enabled FPGA Family)在連接和加速應(yīng)用中顛覆了原有的功耗、尺寸和成本規(guī)則
發(fā)布時(shí)間:2018-06-14
在許多新興大批量應(yīng)用領(lǐng)域,設(shè)備設(shè)計(jì)人員會(huì)混合使用 FPGA 和 ASIC 來快速構(gòu)建能夠滿足嚴(yán)格的成本、功耗和外形限制的、靈活的系統(tǒng)。 在 ECP5 FPGA 系列開發(fā)過程中,Lattice 顛覆了所有 FPGA 都具有最高密度、高能耗和價(jià)格昂貴的規(guī)則。 Lattice 專注于緊湊型大批量應(yīng)用,針對(duì)低成本、小體積和低功耗對(duì) ECP5 架構(gòu)進(jìn)行了優(yōu)化。 這些特性使 ECP5 器件非常適用于實(shí)現(xiàn)可編程連接解決方案,從而完善 ASIC 和 ASSP。
ECP5? SERDES 使能型 FPGA 系列特性
270 Mbps 至 3.2 Gbps,適合通用 8b10b、10 位 SERDES 和 8 位 SERDES 模式
每器件多達(dá) 4 個(gè)通道,采用雙通道模塊以達(dá)到更高的粒度
增強(qiáng)型 DSP 塊將資源提升至 2 倍,適用于對(duì)稱濾波器
低于 80 mW(典型值)的低靜態(tài)功耗、內(nèi)核電壓為 1.1 V 的低動(dòng)態(tài)功耗
可編程 IO 支持 LVCMOS 33/25/18/15/12、XGMII、LVTTL、LVDS、總線 LVDS、7:1 LVDS、LVPECL 和 MIPI D-PHY 輸入接口
| 圖片 | 數(shù)據(jù)手冊(cè) | 產(chǎn)品型號(hào) | 產(chǎn)品分類 | 產(chǎn)品描述 | 價(jià)格 | 操作 |
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| 圖片 | 數(shù)據(jù)手冊(cè) | 產(chǎn)品型號(hào) | 產(chǎn)品分類 | 產(chǎn)品描述 | 價(jià)格 | 操作 |
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![]() | | LFE5U-12F-7BG381C | PLD可編程邏輯器件-可編程邏輯器件 | ¥137.09380 | 在線訂購 |
| 圖片 | 數(shù)據(jù)手冊(cè) | 產(chǎn)品型號(hào) | 產(chǎn)品分類 | 產(chǎn)品描述 | 價(jià)格 | 操作 |
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