MC100EP196

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?3.3 V ECL Programmable Delay Chip

制造商：ON

中文數(shù)據(jù)手冊

產(chǎn)品信息

The MC100EP196 is a programmable delay chip (PDC) designed primarily for clock deskewing and timing adjustment. It provides programmably variable delay of a differential ECL input signal. It has similar architecture to the EP195 with the added feature of further tuneability in delay using the FTUNE pin. The FTUNE input takes an analog voltage from V
to V
to fine tune the output delay from 0 to 60 ps.

Maximum Frequency > 1.2 GHz Typical
PECL Mode Operating Range: V
= 3.0 V to 3.6 V with V
= 0 V
NECL Mode Operating Range: V
= 0 V with V
= -3.0 V to -3.6 V
Open Input Default State
Safety Clamp on Inputs
A Logic High on the ENbar Pin Will Force Q to Logic Low
D[0:10] Can Accept Either ECL, LVCMOS, or LVTTL Inputs
V
Output Reference Voltage
Pb-Free Packages are Available

電路圖、引腳圖和封裝圖

MC100EP196電路圖

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型號	制造商	描述	購買
MC100EP196FAR2G	ON	IC DELAY LN 1024TAP PROG 32LQFP	立即購買
MC100EP196FAG	ON	Delay Line IC Programmable 1024 Tap 2.36ns ~ 12.258ns 32-LQFP	立即購買

技術(shù)資料

標(biāo)題	類型	大?。↘B）	下載
AC Characteristics of ECL Devices	PDF	896	點(diǎn)擊下載
ECL Clock Distribution Techniques	PDF	54	點(diǎn)擊下載
Interfacing Between LVDS and ECL	PDF	121	點(diǎn)擊下載
Designing with PECL (ECL at +5.0 V)	PDF	102	點(diǎn)擊下載
The ECL Translator Guide	PDF	142	點(diǎn)擊下載
Odd Number Divide By Counters with 50% Outputs and Synchronous Clocks	PDF	90	點(diǎn)擊下載
ECLinPS, ECLinPS Lite, ECLinPS Plus and GigaComm Marking and Ordering Information Guide	PDF	71	點(diǎn)擊下載
Storage and Handling of Drypack Surface Mount Device	PDF	49	點(diǎn)擊下載

應(yīng)用案例更多案例

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系列產(chǎn)品索引查看所有產(chǎn)品

MC100EP196	MCP616	MJW21193	MIC2165
MCP1252	MC74AC05	MMA7455	MCP1316M
MC74ACT163	MC1558-DIE	MM74HC595	MC34262
MIC4605	MCP3901	MICRF229	MC14538B
MIC281	max232cse	MC74AC573	MJW21195

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